STN - Slowakische nationale Normen

Designation of phase differences by hour numbers in three-phase AC systems

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Delay and power calculation standards -- Part 2: Pre-layout delay calculation specification for CMOS ASIC libraries

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Delay and power calculation standards -- Part 1: Integrated circuit delay and power calculation systems

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Design automation. Part 1: VHDL language reference manual

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Behavioural languages. Part 2: VHDL multilogic system for model interoperability

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Behavioural languages. Part 3-2: Mathematical operation in VHDL

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Behavioural languages. Part 3-3: Synthesis in VHDL

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Design automation. Part 1: Standard test language for all systems. Common abbreviated test language for all systems (C/ATLAS)

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Electronic Design Interchange Format (EDIF). Version 3 0 0 (IEC 61690- 1:2000)

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Electronic Design Interchange Format (EDIF). Part 2: Version 4 0 0 (IEC 61690-2:2000)

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